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坦率讲,笔者还真的很不想下这个明眼人一看就知道尺度谜底的题目。对于追求输出率的伺服器应用来说,将执行绪层级平行化 (TLP, Thread-Level Paralleli *** ) 转换成指令层级平行化 (ILP, Instruction-Level Paralleli *** ) 的同步多重执行绪 ( *** T, Simultaneous Multi-Threading,或称为同时多执行绪),只管有一些昂贵的分外价值,像IBM Power5焦点比Power4多出24%的功效电路,但 *** T仍是提升超纯量处置器的输出率 (Throughput),最有希望的方式,也是为何Intel、IBM和厥后跟进的AMD,有志一同选择 *** T的主因。请列位科科务必莫忘「王者」IBM这个RISC处置器生长逻辑极限的存在。

硬科技:AMD同时多执行绪 *** T4是什么?图解CPU种种焦点与执行绪关系
硬科技:科科应该要知道的Apple M1盲点
硬科技:科科应该要知道的Apple M1盲点 续篇


有读过现代2位RISC大师的计量方式第三版的科科,也一定会记得生长 *** T的主要念头,来自于当今的多重指令派发处置器,通常在功效单元的平行化上,会比单一执行绪来得有用。此外,由于暂存重视新命名和动态排程的缘故,差异执行绪之间所派发的指令,可以不去思量指令之间的相依性。事实动态排程处置器已经存在了许多「现成」的硬体机制,同步多重执行绪能够行使这些机制,合并TLP的使用来完成多重执行绪,让差异执行绪发出的指令,能够在资料路径中夹杂执行,激增处置器的整体输出率。

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若是看不懂以上的文字叙述也没关系。暂且岂论 *** T并不会提升单一执行绪的效率这档事,只要测试软体没有将 *** T处置器「塞好塞满」,就即是是少了很大一块的效能输出率,这着实没什么好争辩的空间,只要想一想昔时单焦点的Pentium 4,开启关闭HyperThreading的差距就知道了。

至于目的行动运算或嵌入式应用的省电处置器 (包罗Intel近代的Atom系统小核),会普遍不接纳 *** T的缘故原由,不外乎降低功耗与降低产物验证庞大度的考量。倘使Apple哪天想不开,设计为了资料中央量身订做全新的处置器微架构,而非延续A系列的焦点,他们照样很难 *** *** T的诱惑,事实这是截然差其余需求。

今天如其「先射箭再画靶」,以Apple M1的单执行绪显示,做为「 *** T无用论」的理论基础,还不如先想想,为何Intel和AMD都市优先以伺服器做为研发x86处置器微架构的更优先事项,况且照样跟桌机笔电一起共用,没有分外另开战线的余力。这才是在批判「x86架构老旧 (虽然常讲这句话的人也许连自己在讲什么「架构」都搞不清晰)」之余,列位科科最该用力认真思索的大哉问:x86带给盘算机工业的危险,到底是什么。

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